Spiketrum算法面积优化硬件实现并集成IC
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Spiketrum算法面积优化硬件实现并集成IC
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AI 综述
MHD Anas Alsakkal 等人提出 Spiketrum 算法的面积优化硬件实现，把时变模拟信号编码为时空脉冲模式，相比此前偏重速度的设计，BRAM 减少 52%、DSP 切片减少 31%、LUT 减少 6%。该实现在 FPGA 上完成验证，并基于 TSMC180 工艺集成进 IC，目前正投稿 IEEE Transactions on Circuits and Systems I 审稿。 实验用于声音与 ECG 分类等真实场景，作者称该方案面向人工耳蜗和神经器件等功耗敏感应用提供可扩展路径。
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最新进展10月14日 12:00
基于 Spiketrum 算法的通用神经形态传感器硬件实现与应用报道时间线
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10月14日
- arXiv eess.SY 系统与控制精选基于 Spiketrum 算法的通用神经形态传感器硬件实现与应用
论文提出 Spiketrum 算法的面积优化硬件实现，将时变模拟信号编码为时空脉冲模式，相比此前偏重速度的设计，BRAM 减少 52%、DSP 切片减少 31%、LUT 减少 6%。该实现在 FPGA 上完成验证，并基于 TSMC180 工艺集成进 IC，实验用于声音与 ECG 分类等真实场景，面向人工耳蜗和神经器件等功耗敏感应用提供可扩展方案。
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