告别 ESP8266!ESPHome 玩家如何挑选 ESP32 芯片
文章对比 ESP32 原版、ESP32-S3、ESP32-C3、ESP32-C6 四款主流芯片在 ESPHome DIY 中的选型:ESP32 内置以太网 MAC 适合有线连接。
推荐理由:文章按预算、算力和连接需求把四款 ESP32 的适用场景拆开,选型时可直接对照。
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芯板坊工程师实地探访工博会,指出开发板与芯片企业主要集中在5.2馆集成电路展(国芯展)的集成电路设计展区,展商包括飞凌、米尔、创龙、EDATEC、全志、瑞芯微、此芯等。
推荐理由:作者实地记录了各展台的具体展位号和展出方案,想去工博会看开发板的读者可按图索骥。
文章讲解 OP-TEE OS 在 Arm TrustZone 安全世界中的架构与功能,包括 TA 管理调度、内存隔离、加密服务、安全存储和 SMC 调用处理。
推荐理由:文章给出Yocto与独立编译两套完整命令及不建议source SDK的三条原因,可直接照做。
SparkFun 发布 Paul Stoffregen 撰写的深度解析,说明 Teensy 4.1 的 MAC 地址由 PJRC 在生产测试时写入 NXP i.MX RT1062 处理器的 OTP fuse,而非 TI DP83825I PHY 芯片,因此更换 PHY 不会改变 MAC 地址。
推荐理由:文章把 MAC 地址来源与被动 PoE 热插拔烧毁 PHY 的实测数据串起来,做自定义板卡的工程师可直接参考其保护思路。
作者拆解正点原子DL16 Plus逻辑分析仪,其核心为紫光PGL22G FPGA加沁恒CH32V305 RISC-V MCU加南亚4Gbit DDR3(可用3.5Gbit)方案,Buffer模式下8通道1GHz、16通道500MHz,原始数据率约8Gbit/s先写入DDR3再经USB 2.0上传,3.5Gbit缓存不压缩约可录0.44秒。
推荐理由:拆解给出了从FPGA到阈值前端的完整链路,可对照理解1GHz采样如何靠PLL多相时钟与DDR3缓存实现。
文章解析中国科学院计算技术研究所牵头的开源 RISC-V 处理器 XiangShan(香山),其昆明湖 V2 版 SPEC CPU 2006 实测达 16.5 分/GHz,首代雁栖湖约 7 分/GHz、南湖约 10 分/GHz。
推荐理由:文章拆解乱序流水线与差分测试机制,并给出可直接执行的仿真构建命令,嵌入式工程师可照做。
文章介绍开源 RISC-V 软核 VexRiscv,它基于 SpinalHDL 用插件化架构取代硬编码流水线,开发者可用几十行 Scala 代码为 CPU 注入专用硬件指令。
推荐理由:文章给出插件化流水线机制与自定义指令示例代码,配合多芯片综合数据,便于评估软核选型。